Remove DecoupledTLB
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a6874c03f7
@ -207,48 +207,3 @@ class TLB(entries: Int)(implicit edge: TLEdgeOut, p: Parameters) extends CoreMod
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}
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}
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}
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}
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class DecoupledTLB(entries: Int)(implicit edge: TLEdgeOut, p: Parameters) extends Module {
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val io = new Bundle {
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val req = Decoupled(new TLBReq).flip
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val resp = Decoupled(new TLBResp)
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val ptw = new TLBPTWIO
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}
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val req = Reg(new TLBReq)
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val resp = Reg(new TLBResp)
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val tlb = Module(new TLB(entries))
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val s_idle :: s_tlb_req :: s_tlb_resp :: s_done :: Nil = Enum(Bits(), 4)
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val state = Reg(init = s_idle)
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when (io.req.fire()) {
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req := io.req.bits
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state := s_tlb_req
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}
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when (tlb.io.req.fire()) {
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state := s_tlb_resp
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}
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when (state === s_tlb_resp) {
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when (tlb.io.resp.miss) {
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state := s_tlb_req
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} .otherwise {
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resp := tlb.io.resp
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state := s_done
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}
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}
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when (io.resp.fire()) { state := s_idle }
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io.req.ready := state === s_idle
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tlb.io.req.valid := state === s_tlb_req
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tlb.io.req.bits := req
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io.resp.valid := state === s_done
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io.resp.bits := resp
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io.ptw <> tlb.io.ptw
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}
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